PIC18F47J13-I/ML【PDF 33/71 页】IC PIC MCU 128KB FLASH 44QFN

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2010-2012 Microchip Technology Inc.

DS41412E-page 39

PIC18(L)F2X/4XK22

2.8

PLL Frequency Multiplier

A Phase-Locked Loop (PLL) circuit is provided as an

option for users who wish to use a lower frequency

oscillator circuit or to clock the device up to its highest

rated frequency from the crystal oscillator. This may be

useful for customers who are concerned with EMI due

to high-frequency crystals or users who require higher

clock speeds from an internal oscillator.

2.8.1

PLL IN EXTERNAL OSCILLATOR

MODES

The PLL can be enabled for any of the external

oscillator modes using the OSC1/OSC2 pins by either

setting the PLLCFG bit (CONFIG1H<4>), or setting the

PLLEN bit (OSCTUNE<6>). The PLL is designed for

input frequencies of 4 MHz up to 16 MHz. The PLL then

multiplies the oscillator output frequency by four to

produce an internal clock frequency up to 64 MHz.

Oscillator frequencies below 4 MHz should not be used

with the PLL.

2.8.2

PLL IN HFINTOSC MODES

The 4x frequency multiplier can be used with the

internal oscillator block to produce faster device clock

speeds than are normally possible with the internal

oscillator. When enabled, the PLL multiplies the

HFINTOSC by four to produce clock rates up to

64 MHz.

Unlike external clock modes, when internal clock

modes are enabled, the PLL can only be controlled

through software. The PLLEN control bit of the

OSCTUNE register is used to enable or disable the

PLL operation when the HFINTOSC is used.

The PLL is designed for input frequencies of 4 MHz up

to 16 MHz.

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PIC18F47J53T-I/ML 功能描述:8位微控制器 -MCU USB 128KB Flash 4KB RAM 12 MIPS 12b ADC RoHS:否制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT

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